笔记本PCB实现最优EMC的三大核心设计策略
笔记本PCB通常选6层或8层板,成本考量下6层是最优选择。但6层板EMC设计长期困扰设计师。笔记本开发设计流程复杂,EMC设计贯穿始终。实际上,最优EMC达成取决于三大核心考量,本文将详细介绍探讨。
首要考量:方案设计阶段
笔记本PCB设计首步是方案设计:确定产品整体宏观布局,包括芯片与过孔位置,而后EMC工程师评估调整芯片位置、过孔需求以满足EMC要求(如桥接位置、时钟芯片位置走线)。可绘制笔记本PCB草图辅助EMC评估。
EMC评估主要覆盖:
- 走线位置与布线:检查LCD与主板连接线走线、FFC/FPC连接器走线;
- PCB高度限制:高速信号线不可布零高度区(PCB含周边配置)。周边配置含HDD、ODD等;
- 外壳屏蔽区检查:高速信号线不可布暴露区或分割区(降低屏蔽效率),如键盘区、内存盖等;
- 笔记本盖检查:含硬件盖、内存盖,确保接地点每30mm与外壳屏蔽层连接;
- 各单元小板接地检查:保证各单元小板通过螺丝与地完美连接,避免大地阻抗、阻止噪声辐射至空间;
- 为专用电路预留接地点确保低接地阻抗;
- 电源噪声区检查:电源区不稳定导致整体设计失败或芯片远离稳定(供电扰动);
- 最关键规则:确认并检查PCB上主芯片布局及其走线趋势。
次要考量:PCB设计阶段
PCB设计是EMC攻关关键环节,优秀PCB设计是最优EMC前提。不考虑EMC的PCB设计必然浪费钱和时间。PCB设计首问:EMI如何产生、为何传播?唯有准确回答两问题才能获得最优设计。答案将在后文讨论。理想PCB设计原则:EMC从设计伊始考量、坚持设计合理性、采用低成本走线技术。详细设计规则:
- 高速信号线不可布连接器下方,电源电路远离连接器;
- 高速信号线不可布板边任何层,板边间距≥50mil;
- USB、LAN、PCI卡信号线远离高速信号线或加地线保护,合理设计地过孔;
- 高速信号线布内层;
- MIC/耳机为模拟电路,尽量与其他电路隔离;
- 时钟信号线从IC出后布内层,与I/O接口信号线及其他走线隔离。时钟线靠近参考地平面改善镜像效应。所有时钟走线靠近时钟源时应具备RC端接;
- 电源地布局紧凑、回路问题最小化。电源间护城河宽度15mil,地平面完整无走线。减少地分割,过多分割增加地阻抗;
- 合理应用去耦电容是PCB设计关键。禁止高速信号线从顶层穿越底层,建立地过孔降低地阻抗。IC端子及各电源层添加去耦电容,至少预留去耦电容位置;
- 根据应用与价格合理选用抗EMI元件。
第三考量:PCB检查阶段
首先植入工程师思维:自由空间高频阻抗377Ω。普通EMI空间辐射中,信号回路阻抗达空间阻抗等效阶段时,信号向空间辐射。理解此点,必须拉低信号回路阻抗。
控制信号回路阻抗主法:缩短信号长度、收缩回路面积。此外,合理端接控制回路反射。实际控制回路一法是关键信号接地:高频下走线本身有阻抗,利用地/地线通过过孔多次连地。许多此类设计成功避免时钟信号辐射超标。
此外,防止信号跨越分割区,许多工程师按信号分割地却在走线时遗忘,导致回路面积大、走线长。
EMI传播环节,合理应用旁路/去耦电容至关重要。旁路电容置芯片电源引脚与地线、引线最短处。去耦电容置电流需求变化最大处,阻止噪声因走线阻抗从电源地线耦合。磁珠可吸收噪声,电感也可滤波,但注意电感有频率响应范围、封装决定频率响应。
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